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標題: 基于FPGA的數字時鐘Verilog源程序 [打印本頁]
作者: dddddddz    時間: 2019-1-26 14:43
標題: 基于FPGA的數字時鐘Verilog源程序
此設計是應用至芯科技開發板為硬件




Verilog源程序如下:
  1. //將50HZ分頻為1KHZ
  2. module freq(clk,rst_n,clk_1khz);

  4.         input clk;
  5.         input rst_n;//復位 低電平有效

  7.         output reg clk_1khz;

  9.         reg [14:0] cnt;//計數器（計數到2500，0,5ms）
  10.        
  11.         parameter cnt_num = 50_000_000 / 1000 /2 - 1 ;//0.5ms
  12.        
  13.         always @ (posedge clk or negedge rst_n)  //異步復位                                                                                                                        
  14.                 begin
  15.                         if(!rst_n)  //復位
  16.                                 begin
  17.                                         cnt <= 15'd0;//15代表位寬 '是形式，d代表十進制，0代表十進制的數值
  18.                                         clk_1khz <= 1'b0;//賦初值
  19.                                 end       
  20.                         else
  21.                                 begin
  22.                                         if(cnt < cnt_num)//計數沒有到0.5
  23.                                                 begin
  24.                                                         cnt <= cnt + 1'd1;//計數器自動加一
  25.                                                 end
  26.                                         else                                                //計數到0.5
  27.                                                 begin
  28.                                                         cnt <= 15'd0;        //計數器清0
  29.                                                         clk_1khz <= ~clk_1khz;//0.5ms高電平 0.5ms低電平
  30.                                                 end
  31.                                 end
  32.                 end

  34. endmodule
復制代碼

所有資料51hei提供下載:
源代碼.rar (4.33 MB, 下載次數: 96)


作者: troy8862    時間: 2019-2-26 17:14
請問這個工程具體實現哪些功能
作者: dddddddz    時間: 2019-5-31 15:23
troy8862 發表于 2019-2-26 17:14
請問這個工程具體實現哪些功能

就是一個電子時鐘，用了至芯科技的開發板
作者: sun在雨中    時間: 2019-6-25 22:13
很棒，非常有用
作者: nieyanshuo    時間: 2019-6-26 13:21
基準時鐘，分不分頻都行的
作者: kingsleyll123    時間: 2019-6-30 13:51
你好，能問問你嗎
作者: 2768559595    時間: 2019-11-20 10:59
時鐘的校準功能需要額外接別的嗎
作者: 天翎    時間: 2019-12-20 15:17
請問樓主是否能幫忙加個時間調整與暫停開始？可加幣，急用，謝謝



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